Быстрый поиск

Реферат: Ответы к Экзамену по Микропроцессорным Системам (микроконтроллеры микрокопроцессоры)

Блок-схема передатчика UART показана на рис. 13.3.

Рис. 13.3. Передатчик UART

Установленный в состояние 1 бит TXEN регистра UCSRB разрешает передачу

данных UART. Передача инициируется записью передаваемых данных в регистр данных

UDR. Данные пересылаются из UDR в сдвиговый регистр передачи в следующих случаях:

Новый символ записан в UDR после того как был выведен из регистра

стоповый бит предшествовавшего символа. Сдвиговый регистр загружается

немедленно.

Новый символ записан в UDR прежде, чем был выведен стоповый бит

предшествовавшего символа. Сдвиговый регистр загружается после выхода

стопового бита передаваемого символа, находившегося в сдвиговом

регистре.

Если из 10(11)-разрядного сдвигового регистра передачи выведена вся

информация (сдвиговый регистр передачи пуст) данные из UDR пересылаются в сдвиговый

регистр. В это время устанавливается бит UDRE (UART Data Register Empty) регистра

статуса USR (UART Status Register). При установленном в состояние 1 бите UDRE

приемопередатчик готов принять следующий символ. Запись в UDR очищает бит UDRE. В

то самое время, когда данные пересылаются из UDR в 10(11)-разрядный сдвиговый

регистр, бит 0 сдвигового регистра сбрасывается в состояние 0 (состояние 0 - стартовый

бит) а бит 9 или 10 устанавливается в состояние 1 (состояние 1 - стоповый бит). Если в

регистре управления UCSRB установлен бит CHR9 (т.е. выбран режим 9-разрядного слова

данных), то бит TXB8 регистра UCSRB пересылается в бит 9 сдвигового регистра передачи.

Сразу после пересылки данных в сдвиговый регистр тактом бод-генератора

стартовый бит сдвигается на вывод TxD. За ним следует LSB данных. Когда будет выдан

стоповый бит сдвиговый регистр загружается новой порцией данных, если она была

записана в UDR во время передачи. В процессе загрузки бит UDRE находится в

установленном состоянии. Если же новые данные не будут загружены в UDR до выдачи

стопового бита, флаг UDRE остается установленным. В этом случае, после того как

стоповый бит будет присутствовать на выводе TxD в течение одного такта, в регистре

управления и статуса UCSRA устанавливается флаг завершения передачи TxC (TX

Complete Flag).

ПРИЕМНИК

Структурная схема приемника UART приведена на рис. 13.4.

Рис. 13.4. Приемник UART

Логика восстановления данных (Front-End Logic) производит выборку состояний

вывода RxD с частотой в 16 раз большей, чем частота передачи. При нахождении линии в

пассивном состоянии одиночная выборка нулевого логического уровня будет

интерпретироваться как падающий фронт стартового бита и будет запущена

последовательность детектирования стартового бита. Считается, что первая выборка

обнаружила первый нулевой логический уровень вероятного стартового бита. На выборках

8, 9 и 10 приемник вновь тестирует вывод RхD на изменение логических состояний. Если

две или более из этих трех выборок обнаружат логические 1, то данный вероятный

стартовый бит отвергается как шумовой всплеск и приемник начнет выявлять и

анализировать следующие переходы из 1 в 0.

Если же был обнаружен действительный стартовый бит, то начинает

производиться выборка следующих за стартовым битом информационных битов. Эти биты

также тестируются на выборках 8, 9 и 10. Логическое состояние бита принимается по двум и

более (из трех) одинаковым состояниям выборок. Все биты вводятся в сдвиговый регистр

приемника с тем значением, которое было определено тестированием выборок.

Тестирование выборок битов принимаемых символов показано на рис. 13.5.

При поступлении стопового бита необходимо, чтобы не менее двух выборок из трех

подтвердили прием стопового бита (показали высокий уровень). Если же две или более

выборок покажут состояния 0, то при пересылке принятого байта в UDR в регистре

управления и статуса UСSRA устанавливается бит ошибки кадра FE (Framing Error). Для

обнаружения ошибки кадра пользователь перед чтением регистра UDR должен проверять

состояние бита FE. Флаг FE очищается при считывании содержимого регистра данных

UART (UDR).

Вне зависимости от того принят правильный стоповый бит или нет, данные

пересылаются в регистр UDR и устанавливается флаг RXC в регистре управления UCSRA.

Регистр UDR фактически является двумя физически отдельными регистрами, один из

которых служит для передачи данных и другой для приема. При считывании UDR

обращение ведется к регистру приема данных, при записи обращение ведется к регистру

передачи. Если выбран режим обмена 9-разрядными словами данных (установлен бит

CHR9 регистра UCR), при пересылке данных в UDR бит RXB8 регистра UCR загружается из

девятого бита сдвигового регистра передачи. Если после получения символа к регистру

UDR не было обращения, начиная с последнего приема, в регистре UCSRA

устанавливается флаг переполнения OR. Это означает, что новые данные, пересылаемые

в сдвиговый регистр, не могут быть переданы в UDR и потеряны. Бит OR буферирован и

доступен тогда, когда в UDR читается байт достоверных данных. Пользователю, для

обнаружения переполнения, необходимо всегда проверять флаг OR после считывания

содержимого регистра UDR.

При очищенном (сброшенном в логическое состояние 0) бите RXEN регистра UCR

прием запрещен.

24. Таймер-счетчик 0.

8-ми разрядный Т/С 0тактируется сигналом синхронизации процессорного ядра или встроенного предделителя, или от внешнего контакта ТО.

Предназначен для выполнения простейших операций: его содержимое программно доступно процессорному ядру для чтения /записи, а при переполнении счетчика генерируется запрос на прерывание программы.

Регистры управления:

р-р управления TCCR0 - управляет тактовой частотой Т/С0 (биты 0-2)

р-р данных TCNT0 – хранит содержимое счетчика (Read/Write)

р-р флагов прерывания TIFR

р-р маски прерывания TIMSK

р-р состояния МК SREG

22. Подключение клавиатуры и индикация.

Большинство микропроцессорных систем в своей работе предполагают возможность изменения внутренних параметров программы, необходимость отображения для пользователя каких-либо данных. Т.о. возникает необходимость включения в систему средств ввода/вывода. Как правило для этого используются клавиатура и различные индикаторы.

Существует несколько способов подключения клавиатуры к портам ввода/вывода:

Проще всего на каждый вход непосредственно подключать одну клавишу. При этом для обеспечения помехозащищенности ненажатое состояние подключают к напряжению питания, через подтягивающий резистор, а при нажатии вход замыкается на землю.

Однако в первом случае не эффективно используются входы микроконтроллера, как правило находящиеся в дефиците, ведь обычно предполагается одновременное нажатие лишь одной клавиши. Можно подключить клавиатуру через мультиплексор (с инвертирующими входами), тогда на N входов микроконтроллера можно подключить до 2N клавиш.

Кроме того клавиатуру можно организовать в виде матрицы. Тогда в матрице из k столбцов и N строк, все клавиши одной строки подключаются к одному входу микроконтроллера/мультиплексора, а выбор столбца осуществляется подачей сканирующего сигнала на один из k выходов подключенных к столбцам матрицы. В случае, когда в ненажатом состоянии клавиши подтянуты к VCC, в качестве сканирующего сигнала ипользуется 0.

Выбор конкретной реализации зависит от неоходимого количества клавиш, свободных портов микроконтроллера, возможности использовать дополнительные микросхемы (мультиплексоров).

При разработке систем не следует не забывать и о подавлении эффекта «дребезга контактов». Защита от дребезга может осуществляться как программно, так и аппаратно. В последнем случае клавиши подключаются не на прямую, а через T-триггер.

Индикация может осуществляться с использованием: светодиодов сегментных индикаторов

Индикаторы могут быть как светодиодные, так и жидкокристаллические, и иметь различное число сегметов.

Как светодиоды, так и сегментные индикаторы могут подключаться к портам микроконтроллера напрямую, либо через дешифратор/демультиплексор.

Набор символов отображаемых сегментными индикаторами может определяться программно через таблицу декодирования, либо аппаратно логикой внешней микросхемы дешифратора.

Схемы подключения индикаторов к системе могут быть разными:

Простая: один порт – один индикатор

Различные варианты распараллеливания канала данных либо канала выбора индикатора

Динамическая индикация (число знаков ограничивается скважностью) Рис. 1

Динамическая индикация методом досчета (скважность постоянная) Рис. 2